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一种基于 FinFET 器件的异或/同或门电路
审中-实审

申请号:201610044398.8 申请日:2016-01-22
摘要:本发明公开了一种基于FinFET器件的异或/同或门电路,包括第一FinFET管、第二FinFET管、第三FinFET管、第四FinFET管、第五FinFET管和第六FinFET管,第一FinFET管和第四FinFET管均为P型FinFET管,第二FinFET管、第三FinFET管、第五FinFET管和第六FinFET管均为N型FinFET管;第一FinFET管和第四FinFET管均为低阈值FinFET管,第二FinFET管、第三FinFET管、第五FinFET管和第六FinFET管均为高阈值FinFET管,第一FinFET管和第四FinFET管鳍的个数均为1,第二FinFET管、第三FinFET管、第五FinFET管和第六FinFET管鳍的个数均为2;优点是在具有正确的逻辑功能的基础上,电路面积、延时、功耗和功耗延时积均较小。
申请人: 宁波大学
地址: 315211 浙江省宁波市江北区风华路818号
发明(设计)人: 胡建平 张绪强
主分类号: H03K19/21(2006.01)I
分类号: H03K19/21(2006.01)I H03K19/20(2006.01)I
  • 法律状态
2016-07-27  实质审查的生效IPC(主分类):H03K 19/21申请日:20160122
2016-06-29  公开
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
  • 其他信息
主权项  一种基于FinFET器件的异或/同或门电路,其特征在于包括第一FinFET管、第二FinFET管、第三FinFET管、第四FinFET管、第五FinFET管和第六FinFET管,所述的第一FinFET管和所述的第四FinFET管均为P型FinFET管,所述的第二FinFET管、所述的第三FinFET管、所述的第五FinFET管和所述的第六FinFET管均为N型FinFET管;所述的第一FinFET管和所述的第四FinFET管均为低阈值FinFET管,所述的第二FinFET管、所述的第三FinFET管、所述的第五FinFET管和所述的第六FinFET管均为高阈值FinFET管,所述的第一FinFET管和所述的第四FinFET管鳍的个数均为1,所述的第二FinFET管、所述的第三FinFET管、所述的第五FinFET管和所述的第六FinFET管鳍的个数均为2;所述的第一FinFET管的源极和所述的第四FinFET管的源极均接入电源,所述的第一FinFET管的漏极、所述的第二FinFET管的漏极、所述的第三FinFET管的漏极和所述的第四FinFET管的前栅和所述的第四FinFET管的背栅连接且其连接端为所述的基于FinFET器件的异或/同或门电路的第一输出端,所述的基于FinFET器件的异或/同或门电路的第一输出端用于输出异或信号,所述的第一FinFET管的前栅、所述的第一FinFET管的背栅、所述的第五FinFET管的漏极、所述的第四FinFET管的漏极和所述的第六FinFET管的漏极连接且其连接端为所述的基于FinFET器件的异或/同或门电路的第二输出端,所述的基于FinFET器件的异或/同或门电路的第二输出端用于输出同或信号,所述的第三FinFET管的前栅和所述的第五FinFET管的前栅连接且其连接端为所述的基于FinFET器件的异或/同或门电路的第一输入端,所述的第一输入端用于输入第一输入信号,所述的第三FinFET管的背栅和所述的第六FinFET管的背栅连接且其连接端为所述的基于FinFET器件的异或/同或门电路的第二输入端,所述的第二输入端用于输入第二输入信号,所述的第二FinFET管的前栅和所述的第六FinFET管的前栅连接且其连接端为所述的基于FinFET器件的异或/同或门电路的第一反相输入端,所述的第一反相输入端用于输入第一输入信号的反相信号,所述的第二FinFET管的背栅和所述的第五FinFET管的背栅连接且其连接端为所述的基于FinFET器件的异或/同或门电路的第二反相输入端,所述的第二反相输入端用于输入第二反相输入信号,所述的第二FinFET管的源极、所述的第三FinFET管的源极、所述的第五FinFET管的源极和所述的第六FinFET管的源极均接地。
公开号  105720970A
公开日  2016-06-29
专利代理机构  宁波奥圣专利代理事务所(普通合伙) 33226
代理人  方小惠
颁证日  
优先权  
国际申请  
国际公布  
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