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一种时钟系统
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申请号:201510243923.4 申请日:2015-05-13
摘要:本发明涉及电子技术领域,具体涉及一种用于电子系统的时钟系统,包括:上位机,与PCI总线相连,用于设置需要输出的时钟的频率,并选择对应的通道;该上位机中设有上层软件模块,与PCI总线相连,用于根据上位机设定的所述需要输出的时钟的频率,计算专用时钟芯片的控制寄存器的值;CPLD,与PCI总线相连,用于获取所述控制寄存器的值,并将其发送给所述专用时钟芯片;所述专用时钟芯片,用于根据所述控制寄存器的值生成相应的时钟信号并输出;通过上述技术方案,本发明可以通过上位机设置输出时钟频率,时钟输出范围超宽,具有高分辨率。本发明还可以控制输出时钟的占空比,满足对占空比有要求的系统需求。
申请人: 中国电子科技集团公司第四十一研究所
地址: 266000 山东省青岛市经济技术开发区香江路98号
发明(设计)人: 张磊
主分类号: G06F1/08(2006.01)I
分类号: G06F1/08(2006.01)I
  • 法律状态
2017-10-03  授权
2015-09-23  实质审查的生效IPC(主分类):G06F 1/08申请日:20150513
2015-08-26  公开
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
  • 其他信息
主权项  一种时钟系统,其特征在于,包括:上位机,与PCI总线相连,用于设置需要输出的时钟的频率,并选择对应的通道;该上位机中设有上层软件模块,与所述PCI总线相连,用于根据上位机设定的所述需要输出的时钟的频率,计算专用时钟芯片的控制寄存器的值;复杂可编程逻辑器件CPLD,与PCI总线相连,用于获取所述控制寄存器的值,并将其发送给所述专用时钟芯片;所述专用时钟芯片,用于根据所述控制寄存器的值生成相应的时钟信号并输出;占空比调整电路,与所述专用时钟芯片的输出端相连,用于调整所述时钟信号的占空比,并输出调整后的时钟信号。
公开号  104866008A
公开日  2015-08-26
专利代理机构  北京众合诚成知识产权代理有限公司 11246
代理人  龚燮英
颁证日  
优先权  
国际申请  
国际公布  
进入国家日期