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不必计算指数差而直接对阶的高速浮点加减部件
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High speed floating point addition and subtraction part capable of direct matching exponents and need not calculating exponential difference

申请号:01141499.5 申请日:2001-09-27
摘要:一种不必计算指数差而直接对阶的高速浮点加减部件,包括:两个移位器,用于移位尾数;指数大小比较逻辑,用于生成移位结果选择信号;两个选通器,用于输出移位后的结果。本发明不仅适用于单通路的体系结构,也适用于双通路体系结构,在双通路体系结构中可以实现只有两个基本加法步长的浮点加减,在单通路的体系结构中可以实现有三个基本加法步长的浮点加减,进一步提高了浮点加减运算速度。
Abstract: The assembly includes the two shifter used to shift the mantissa, the logic for comparing the magnitude of the exponent used to generate the selection signal of the result shifted, the two gates usedto output the result shifted. The invention not only suits the system architecture of single channel, but also suits the system architecture of two channels. In the system architecture of two channels, the floating point adding and substracting with two steps of basic addition can be realized. In the system architecture of single channel, the floating point adding and substracting with three steps of basic addition can be realized. The invention increases the arithmetic speed of the floating point adding and subtracting.
申请人: 中国科学院计算技术研究所
Applicant: INST COMPUTING TECH CN ACADEMY[CN]
地址: 100080北京市********(隐藏)
发明(设计)人: 王海霞 唐志敏 周旭
Inventor: WANG HAIXIA[CN]; TANG ZHIMIN[CN]; ZHOU XU[CN]
主分类号: G06F5/01
分类号: G06F5/01
  • 法律状态
2005-05-18  授权
2003-07-02  
2003-04-16  公开
2002-01-09  
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
  • 其他信息
主权项  1.一种不必计算指数差而直接对阶的高速浮点加减部件,其特征在 于包括: 两个移位器,用于移位尾数; 指数大小比较逻辑,用于生成移位结果选择信号; 两个选通器,用于输出移位后的结果。
公开号  1410877A
公开日  2003-04-16
专利代理机构  中科专利商标代理有限责任公司
代理人  戎志敏
颁证日  
优先权  
国际申请  
国际公布  
进入国家日期  
  • 专利对比文献
类型 阶段 文献号 公开日期 涉及权利要求项 相关页数
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  • 期刊对比文献
类型 阶段 期刊文摘名称 作者 标题 涉及权利要求项 相关页数
  • 书籍对比文献
类型 阶段 书名 作者 标题 涉及权利要求项 相关页数
  • 附加信息
同族专利
CN1202469C
 
引用文献
 
被引用文献
CN102789376A